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Concurso:
Prefeitura de Araguaína - TO
Disciplina:
Arquitetura de Computadores
Um estúdio de pós-produção cinematográfica necessita expandir seu armazenamento local para processar arquivos de imagens brutas em alta resolução, priorizando a obtenção de elevado desempenho de leitura e escrita através da fragmentação de dados em blocos distribuídos entre múltiplos discos físicos, sem a adição de qualquer redundância ou paridade, sendo essa configuração denominada:
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Prefeitura de Araguaína - TO
Disciplina:
Arquitetura de Computadores
Ao provisionar um novo servidor de alta densidade para um data center corporativo, o arquiteto de infraestrutura seleciona um processador baseado em uma arquitetura de conjunto complexo de instruções, a qual utiliza códigos de tamanho variável e modos de endereçamento avançados para manipular diretamente dados na memória, sendo o modelo escolhido pertencente à família:
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Prefeitura de Araguaína - TO
Disciplina:
Arquitetura de Computadores
Em um laboratório universitário de arquitetura de computadores, os alunos desenvolvem um projeto acadêmico utilizando um processador didático caracterizado por pertencer à família de arquiteturas RISC, possuindo um conjunto reduzido e altamente padronizado de instruções de tamanho fixo, operando com o modelo load/store e executando a maioria das operações em um único ciclo de clock, sendo essa arquitetura clássica conhecida como:
Concurso:
Prefeitura de Araguaína - TO
Disciplina:
Arquitetura de Computadores
Durante a depuração de um código de baixo nível, um programador identifica um valor de endereço de memória exibido no depurador na base hexadecimal como 1A3F e precisa transcrever esse mesmo valor na base octal para registrá-lo em um sistema legado, sendo o número convertido igual a:
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Prefeitura de Araguaína - TO
Disciplina:
Arquitetura de Computadores
Durante a execução de um programa, um processador moderno divide o ciclo de instrução em estágios sequenciais, como busca, decodificação, execução, acesso à memória e escrita de resultado, permitindo que múltiplas instruções sejam processadas simultaneamente em diferentes fases do ciclo de clock, sendo essa técnica de paralelismo denominada: